Serwis Infona wykorzystuje pliki cookies (ciasteczka). Są to wartości tekstowe, zapamiętywane przez przeglądarkę na urządzeniu użytkownika. Nasz serwis ma dostęp do tych wartości oraz wykorzystuje je do zapamiętania danych dotyczących użytkownika, takich jak np. ustawienia (typu widok ekranu, wybór języka interfejsu), zapamiętanie zalogowania. Korzystanie z serwisu Infona oznacza zgodę na zapis informacji i ich wykorzystanie dla celów korzytania z serwisu. Więcej informacji można znaleźć w Polityce prywatności oraz Regulaminie serwisu. Zamknięcie tego okienka potwierdza zapoznanie się z informacją o plikach cookies, akceptację polityki prywatności i regulaminu oraz sposobu wykorzystywania plików cookies w serwisie. Możesz zmienić ustawienia obsługi cookies w swojej przeglądarce.
a low-power all-digital PLL (ADPLL) is proposed for the 2.4G wireless communication applications. A new scheme is proposed for noise reduction of the quantization noise that is caused by the metastability between reference clock and the DCO output clock (CKV). The ADPLL is designed and fabricated in 0.65µm CMOS process, the whole digital block area is 0.065 mm2(include TDC).
This paper presents a self-resetting repeater based energy-efficient transceiver for a 28 nm 8×8 core NoC. The proposed transceiver operates error free up to a data rate of 5.1 Gb/s with an energy efficiency of 60.3 fJ/b/mm and latency of 98 ps/mm over 16 mm link with repeaters at every 1 mm. Owing to proposed circuit schemes including variable delay, pulse amplitude control and dual-edge demodulator...
This paper reports the first fully integrated transmitter designed in an 180nm BCD process for light-emitting diode (LED) based visible light communication (VLC) and positioning (VLP) systems. The transmitter consists of Manchester coder, precision voltage and current reference, multistage Cherry-Hooper amplifier, PLL, filter and LED driver. A feed-forward equalizer is used to boost the LED bandwidth...
Time synchronization is critical in distributed network system. A variety of network protocols, middleware and business applications rely on proper time synchronization across the computational infrastructure and depend on the clock accuracy. The “Network Time Protocol” (NTP) is the current widely accepted standard for synchronizing clocks over the Internet. In order to reduce access frequency to...
This system designed IC RF card lab management system on the basis of microprocessor AT89C52 which was produced by Atmel company. This text introduced the influence of hardware environment to IC RF reading and writing system, analysed and designed the whole IC RF card read-write equipment from the angle of security, confidentiality and stability of the system.
Time synchronization is one of core technologies in distributed systems and communication fields. The "Network Time Protocol" (NTP) is the current widely accepted standard for synchronizing clocks over the Internet. NTP uses a hierarchical scheme in order to synchronize the clocks in the network. It mainly adopts a phase-locked loop technique to adjust the local clock. This paper develops...
Podaj zakres dat dla filtrowania wyświetlonych wyników. Możesz podać datę początkową, końcową lub obie daty. Daty możesz wpisać ręcznie lub wybrać za pomocą kalendarza.